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一种SOC架构下的处理器核动态变频装置和方法

一种SOC架构下的处理器核动态变频装置和方法

  • 专利类型:发明专利
  • 有效期:不限
  • 发布日期:2021-07-15
  • 技术成熟度:详情咨询
交易价格: ¥面议
  • 法律状态核实
  • 签署交易协议
  • 代办官方过户
  • 交易成功

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  • 申请号 CN200410004593.5 
  • 公开号 CN1661512A 
  • 申请日 2004/02/24 
  • 公开日 2005/08/31 
  • 申请人 中国科学院计算技术研究所  
  • 优先权日期  
  • 发明人 张志敏  
  • 主分类号  
  • 申请人地址 100080北京市海淀区中关村科学院南路6号 
  • 分类号  
  • 专利代理机构 北京泛华伟业知识产权代理有限公司 
  • 当前专利状态 发明专利申请公布 
  • 代理人 王凤华 
  • 有效性 发明公开 
  • 法律状态 发明专利申请公布
  •  
  • 01

    项目简介

    本发明公开了一种SOC架构下的处理器核动态变频装置和方法,该变频装置包括处理器核和为处理器核提供时钟信号的主锁相环和辅助锁相环,用于存储变频系数的变频寄存器与主锁相环连接,时钟切换电路切换主锁相环和辅助锁相环输出的时钟信号,并将主锁相环和辅助锁相环输出的时钟信号中的一个提供给处理器核。时钟切换电路包括一变频标记输入端,该输入端接收变频标记信号。采用本发明的变频装置和方法可以实现处理器核的动态变频,根据变频寄存器中不同的变频系数,该变频装置可以为处理器核提供多种频率的时钟总线,并且实现动态切换,以供系统在不同的负载下使用,达到系统合理利用功耗、节省电能的目的。
    展开
  • 02

    说明书

    1、一种SOC架构下的处理器核动态变频装置,包括处理器核和一个为处理器核 提供时钟信号的主锁相环,其特征在于,还包括: 一个辅助锁相环,用于向处理器核提供时钟信号; 一个时钟切换电路,该电路切换主锁相环和辅助锁相环输出的时钟信号,并将 主锁相环和辅助锁相环输出的时钟信号中的一个提供给处理器核; 一个与主锁相环连接的变频寄存器,用于存储变频系数。 其中,所述时钟切换电路包括一变频标记输入端,该输入端接收变频标记信号, 该变频标记信号控制时钟切换电路对主锁相环和辅助锁相环输出的时钟信号进行切 换。 2、根据权利要求1所述的SOC架构下的处理器核动态变频装置,其特征在于, 所述辅助锁相环复用SOC上用于产生外围部件的时钟的锁相环。 3、一种SOC架构下的处理器核动态变频方法,包括步骤: 1)发送一变频标记信号至切换电路; 2)切换电路将时钟总线从主锁相环切换至辅助锁相环; 3)更新变频寄存器中的变频系数; 4)变频标记信号发生电位变化; 5)切换电路将时钟总线从辅助锁相环切换回主锁相环。 4、根据权利要求3所述的SOC架构下的处理器核动态变频方法,其特征在于, 步骤2)中,切换电路首先将主锁相环提供的时钟总线切断,然后接通辅助锁相环 提供的时钟总线。 5、根据权利要求3所述的SOC架构下的处理器核动态变频方法,其特征在于, 步骤5)中,切换电路首先将辅助锁相环提供的时钟总线切断,然后接通主锁相环 提供的时钟总线。
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